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GigaDVP

Le processeur vidéo-numérique GigaDVP

Note: l'information qui suit est de nature préliminaire; les premières livraisons du GigaDVP sont prévues pour l'été 2003. Pour des besoins immédiats, voyez le μGVP

Sommaire des possibilités:

L'architecture largement programmable du GigaDVP lui permet de répondre à une foule de besoins requérant une ou une combinaison de plusieurs de ces possibilités.

Architecture du GigaDVP

Le GigaDVP comporte des circuits de dé-sérialisation et re-sérialisation du signal vidéo-numérique (SDI) avec détection et régénération des blocs de contrôle d'erreur (EDH). Ce circuit alimente une unité de traitement vidéo-numérique simple, mais rapide, réalisée en logique programmable (CPLD). Une mémoire vidéo contient les instructions et données de l'unité de traitement vidéo-numérique. Cette mémoire est constituée de deux blocs totalement indépendants permettant la préparation d'un bloc en arrière-plan pendant l'affichage de l'autre. Un micro-contrôleur rapide (RISC) est utilisé pour la gestion de l'unité et la préparation du signal vidéo-numérique.

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